TMS320VC5409APGE16 Digitaler Signalprozessor IC DSP Integrierte Schaltkreise QFP144

TMS320VC5409APGE16 Digitale Signalprozessoren DSP Integrierte Schaltungen QFP144 Texas Instruments ICs

Beschreibung:

Der digitale Festkomma-Signalprozessor (DSP) TMS320VC5409A (im Folgenden als 5409A bezeichnet
sofern nicht anders angegeben) basiert auf einer erweiterten modifizierten Harvard-Architektur mit einem Programm
Speicherbus und drei Datenspeicherbusse.Dieser Prozessor stellt eine Arithmetik-Logik-Einheit (ALU) mit einer
hoher Grad an Parallelität, anwendungsspezifische Hardwarelogik, On-Chip-Speicher und zusätzlicher On-Chip
Peripheriegeräte.Grundlage für die Einsatzflexibilität und Schnelligkeit dieses DSP ist ein hochspezialisierter Unterricht
einstellen.

Getrennte Programm- und Datenräume ermöglichen einen gleichzeitigen Zugriff auf Programmanweisungen und Daten, Bereitstellung
ein hohes Maß an Parallelität.Zwei Leseoperationen und eine Schreiboperation können in einem einzigen ausgeführt werden
Kreislauf.Befehle mit Parallelspeicher und anwendungsspezifischen Befehlen können diese Architektur vollständig nutzen.
Außerdem können Daten zwischen Daten- und Programmräumen übertragen werden.Eine solche Parallelität unterstützt a
leistungsstarke Reihe von arithmetischen, logischen und Bit-Manipulationsoperationen, die alle in einem einzigen ausgeführt werden können
Maschinenzyklus.Der 5409A enthält auch die Steuermechanismen zur Verwaltung von Interrupts, wiederholt
Operationen und Funktionsaufrufe.

Spezifikation: Festkomma-Digitalsignalprozessor-IC

Merkmale:

Fortschrittliche Multibus-Architektur mit drei getrennten 16-Bit-Datenspeicherbussen und einem parallelen Lastspeicher

• Bedingte Speicherbefehle programmieren den Speicherbus

• Schnelle Rückkehr nach Unterbrechung

• 40-Bit-Arithmetik-Logik-Einheit (ALU) mit a

• On-Chip-Peripheriegeräte 40-Bit-Barrel-Shifter und zwei unabhängige – Software-programmierbare 40-Bit-Akkumulatorgeneratoren mit Wartezustand und programmierbar

• 17- × 17-Bit-Parallelmultiplikator, gekoppelt an einen dedizierten 40-Bit-Addierer mit Bankumschaltung für nicht-pipelined – auf dem Chip programmierbaren phasenverriegelten Single-Cycle-Multiply/Accumulate (MAC)-Loop (PLL)-Taktgenerator mit internem Betrieb Oszillator oder externe Taktquelle(1) • Vergleichs-, Auswahl- und Speichereinheit (CSSU) für – eine 16-Bit-Timer-Add/Compare-Auswahl des Viterbi-Operators – Sechskanal-DMA-Controller (Direct Memory Access).

• Exponentencodierer zum Berechnen eines Exponentenwerts von – drei gepufferten seriellen Ports mit mehreren Kanälen einem 40-Bit-Akkumulatorwert in einem (McBSPs) Einzelzyklus – 8/16-Bit Enhanced Parallel Host-Port

• Zwei Adressgeneratoren mit acht Hilfsschnittstellenregistern (HPI8/16) und zwei Hilfsregistern

• Stromverbrauchssteuerung mit IDLE1, Arithmetic Units (ARAUs) IDLE2 und IDLE3-Anweisungen mit

• Datenbus mit Bushalter-Funktion Power-Down-Modi • Erweiterter Adressierungsmodus für 8M × 16-Bit

• Steuerung CLKOUT Off zum Deaktivieren des maximal adressierbaren externen Programms CLKOUT

• On-Chip Scan-basierte Emulationslogik, IEEE Space Std 1149.1 (JTAG) Boundary Scan Logic (2)

• 32K × 16-Bit-On-Chip-RAM Bestehend aus: • 144-Pin Ball Grid Array (BGA) (GGU-Suffix) – Vier Blöcke von 8K × 16-Bit-On-Chip-Dual-Access-Programm-/Daten-RAM

• 144-Pin-Low-Profile-Quad-Flatpack (LQFP) (PGE-Suffix) • 16K × 16-Bit-On-Chip-ROM, konfiguriert für Programmspeicher

• 6,25 ns Einzelzyklus-Festkomma-Befehlsausführungszeit (160 MIPS) • Erweiterte externe parallele Schnittstelle (XIO2)

• 8,33-ns-Einzelzyklus-Festkommabefehl

• Ausführungszeit für Einzelbefehlswiederholung und Blockwiederholungsoperationen (120 MIPS) für Programmcode

• 3,3-VI/O-Versorgungsspannung (160 und 120 MIPS)

• Block-Memory-Move-Anweisungen für bessere Programm- und Datenverwaltung

• 1,6-V-Core-Versorgungsspannung (160 MIPS)

• Befehle mit einem 32-Bit-Long-Word-Operanden

• 1,5-V-Core-Versorgungsspannung (120 MIPS) (1) Der On-Chip-Oszillator ist nicht auf allen 5409A-Geräten verfügbar.

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